Artikel-ID: 000077856 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 04.12.2014

Wie generiere ich Configuration via Protocol (CvP)-Programmierdateien für Arria®-V- oder Cyclone®-V-Designs?

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • Arria® V Hard IP für PCI Express* Intel® FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Um CvP-Programmierdateien für Arria®-V- oder Cyclone®-V-CvP-Designs mit Quartus® II-Softwareversion 13.1 und früher zu generieren, befolgen Sie die folgenden Schritte zur Problemumgehung/Korrektur:

    Lösung

    Stellen Sie sicher, dass Sie über ein CvP-Gerät verfügen, das für eine CvP-Revision geeignet ist.

    Dazu beziehen Sie sich auf den Abschnitt Konfiguration über Protokoll des Geräte-Errata-Blatts für die erforderlichen Chip-Codes.

    Die Problemumgehung erfordert die folgenden Schritte:

    a) Hinzufügen/erstellen Sie Folgendes. INI-Variablen in einer quartus.ini-Datei in Ihrem Quartus-Projektverzeichnis® ( <Working_Directory>/ ), um die Generierung von CvP-Programmierdateien zu ermöglichen

    PGMIO_ENABLE_CVP=EIN
    PGMIO_ENABLE_AUTONOMOUS_HIP_MODE=EIN

    PGMIO_CREATE_CVP_FILES=EIN

    PGMIO_DISABLE_AV_CV_AUTONOMOUS=AUS
    ASM_FORCE_ENABLE_AUTONOMOUS_PCIE_HIP=EIN

    b) Fügen Sie optional die folgenden QSF-Einstellungen hinzu, wenn Sie die folgende Pin-Funktion verwenden möchten:

    • Aktivieren Sie den CvP CONFDONE-Pin

    set_global_assignment -name ENABLE_CVP_CONFDONE AN

    • Einstellen des CvP CONFDONE-Pin-Typs

    set_global_assignment -name CVP_CONFDONE_OPEN_DRAIN AN

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 6 Produkte

    Cyclone® V FPGAs und SoC FPGAs
    เอฟพีจีเอ Arria® V GX
    Arria® V FPGAs und SoC FPGAs
    เอฟพีจีเอ Arria® V GT
    เอฟพีจีเอ Cyclone® V GX
    เอฟพีจีเอ Cyclone® V GT

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