Artikel-ID: 000077456 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 15.06.2015

Timing-Analyseproblem bei Arria 10 Geräten in der Quartus II SoftwareVersion 15.0

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    In der Quartus II Softwareversion 15.0 kann der "Quartus II"-Treiber zwei Register fälschlicherweise mit verschiedenen timing-Ausnahmen (z. B. Falsche Pfade oder Mehrerezyklen) zusammenführen. Das resultierende Register kann eine unvollständige Liste zugewiesener Ausnahmen haben, was zu falsch analysierte Pfade zu und/oder aus dem Register. Dieses Problem kann als Falsche Timing-Verletzungen oder Hardware-Ausfälle auftreten. Dieses Problem tritt nur bei Designs auf, die auf Arria 10 Geräte abzielen.

    Sie können dieses Problem erkennen, wenn Sie eine Timing-Verletzung generieren oder TimeQuest eine Ausnahme generiert, die eine Warnung ignoriert hat. Andernfalls ist die Erkennung dieses Problems schwierig.

    Lösung

    Dieses Problem wird in einer kommenden Software-Version behoben.

    Wenn Sie dieses Problem mit der Quartus II Softwareversion Verison 15.0 erkennen, können Sie die folgenden Problemumgehungen verwenden:

    • Weisen Sie den falsch duplizierten Registern eine Zuweisung einer PRESERVE_REGISTER Zuweisung zu.
    • Deaktivieren Sie TimeQuest2, indem Sie die Quartus II Settings File (.qsf) Ihres Projekts hinzufügenset_global_assignment -name TIMEQUEST2 OFF.
    • Deaktivieren Sie die Register-Retiming, indem Sie unter Zuweisungen > Einstellungen > Compiler-Einstellungen das Kontrollkästchen Register retiming verhindern aktivieren
    • Ändern Sie die Synopsys Design Constraints (SDC), um Unterschiede in den Ausnahmen des Registers zu beseitigen.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Arria® 10 FPGAs und SoC FPGAs

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