Artikel-ID: 000076700 Inhaltstyp: Produktinformationen und Dokumente Letzte Überprüfung: 02.02.2018

Wie kann ich die IOPLL-Jitter-Leistung erreichen, wie im Datenblatt Intel® Stratix® 10 Geräte angegeben?

Umgebung

  • PLL
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Um die im Intel Stratix 10 Gerätedatenblatt angegebene Intel® Stratix® 10 IOPLL-Jitter-Leistung zu erreichen, begrenzen Sie die Anzahl der nicht beendeten SSO-Pins (Simultan Switching Output) innerhalb einer IO-Bank auf die in der tabelle unten angegebene Zahl für jede aktuelle Stärke.

    SSO-Stiftstromstärke (mA)

    Maximale Anzahl von SSO-Pins

    Jitter-Erhöhung pro SSO-Pin (ps/pin)

    16

    17

    8

    12

    21

    7

    10

    27

    6

    8

    36

    4

    Wenn Ihre Anwendung mehr nicht beendete Stiftkontakte gleichzeitig zum Umschalten benötigt, wird sich die PLL-Ausgabe-Jitter-Spezifikation von der in der Tabelle angegebenen Menge auswirken. Die Spezifikationen der externen Speicherschnittstelle sind nicht betroffen, da die auswirkungen zusätzlicher Schwankungen in den maximalen Datenraten berücksichtigt werden, die von Intel Stratix 10 Geräten unterstützt werden.

    Diese Richtlinie gilt für die folgenden Geräte:

    • Intel Stratix 10 GX ES3 und Produktionsgeräte
    • Intel Stratix 10 SX ES1-, ES2- und Produktionsgeräte
    Lösung

    Die Dokumentation wurde aktualisiert.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 2 Produkte

    Intel® Stratix® 10 GT SoC-FPGA
    เอฟพีจีเอ Intel® Stratix® 10 GX

    Der Inhalt dieser Seite ist eine Kombination aus menschlicher und computerbasierter Übersetzung des originalen, englischsprachigen Inhalts. Dieser Inhalt wird zum besseren Verständnis und nur zur allgemeinen Information bereitgestellt und sollte nicht als vollständig oder fehlerfrei betrachtet werden. Sollte eine Diskrepanz zwischen der englischsprachigen Version dieser Seite und der Übersetzung auftreten, gilt die englische Version. Englische Version dieser Seite anzeigen.