Artikel-ID: 000076534 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 16.10.2020

Warum sehe ich eine große Anzahl von Warnungen im Zusammenhang mit RAM-Blöcken, die synthetisiert werden, wenn ich ein Intel® Stratix® 10-FPGA- oder Intel Agilex® 7-Design mit dem JESD204C-Intel® FPGA IP im RX-Simplex-Modus kompiliere?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • JESD204B Intel® FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    Wenn Sie ein Design mit dem JESD204C-Intel® FPGA IP im RX-Simplex-Modus erstellen, das auf Intel® Stratix® 10 Geräte mit E-Tile-Transceivern oder Intel Agilex® 7-Geräte mit der Intel® Quartus® Prime Pro Edition-Software Version 19.2 und höher abzielt, sehen Sie möglicherweise Warnungen wie die unten gezeigten.

    Die folgenden Warnungen beziehen sich auf die Signale rx_eb_data_soemb_out_w_w[L-1:0] und rx_eb_data_somb_out_w_w[L-1:0] und können ignoriert werden, da jeweils nur das Bit [0] als Eingabe für die Transportschicht verwendet wird.

    Warnung(14320): Synthetisierter entfernter Knoten "u_j204c_rx_tx_ss|j204c_rx_tx_ip|intel_jesd204c|intel_jesd204c|j204c_rx_base_inst|j204c_rx_ll_top_inst|rx_ll_per_lane_inst[0].j204c_rx_eb_inst|j204c_eb_fifo|j204c_rx_eb_fifo_noecc_inst|j204c_rx_eb_fifo_noecc|scfifo_component|auto_generated|dpfifo|FIFOram|altera_syncram_impl1|q_b[129]"

    Warnung(14320): Synthetisierter entfernter Knoten "u_j204c_rx_tx_ss|j204c_rx_tx_ip|intel_jesd204c|intel_jesd204c|j204c_rx_base_inst|j204c_rx_ll_top_inst|rx_ll_per_lane_inst[0].j204c_rx_eb_inst|j204c_eb_fifo|j204c_rx_eb_fifo_noecc_inst|j204c_rx_eb_fifo_noecc|scfifo_component|auto_generated|dpfifo|FIFOram|altera_syncram_impl1|q_b[130]"

    Die folgenden Warnungen beziehen sich auf Signale j204c_rx_cmd_data [18:7], wenn die Konfiguration des Sync-Headers CRC-12 ist.

    Diese können jedoch sicher ignoriert werden, da die CRC-12-Konfiguration nur die unteren 7 Bit verwendet (daher werden 12 Signale wegsynthetisiert).

    Warnung(14320): Synthetisierter entfernter Knoten "u_j204c_rx_tx_ss|j204c_rx_tx_ip|intel_jesd204c|intel_jesd204c|j204c_rx_base_inst|j204c_rx_ll_top_inst|rx_ll_per_lane_inst[0].j204c_rx_eb_inst|j204c_eb_fifo|j204c_rx_eb_fifo_noecc_inst|j204c_rx_eb_fifo_noecc|scfifo_component|auto_generated|dpfifo|FIFOram|altera_syncram_impl1|q_b[138]"

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    Lösung

    Diese Warnmeldungen werden erwartet und können ignoriert werden.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 3 Produkte

    เอฟพีจีเอ Intel® Stratix® 10 TX
    เอฟพีจีเอ Intel® Stratix® 10 MX
    Intel® Agilex™ FPGAs und SoC FPGAs

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