Artikel-ID: 000076094 Inhaltstyp: Produktinformationen und Dokumente Letzte Überprüfung: 12.09.2012

Wie stelle ich ein konsistentes Verhalten zwischen Avalon-MM und Avalon-ST PCIE HIP in den Arria V- oder Cyclone V-Gerätereihen sicher?

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Für die Arria® V- und Cyclone® V-Gerätereihen müssen, um ein konsistentes Verhalten zwischen der Avalon®-MM und Avalon-ST PCI Express® Hard IP sicherzustellen, 2 Parameter vom Avalon-MM-Wrapper geändert werden, um die Standardwerte im Avalon-ST-Wrapper zu entsprechen.

    Lösung

    In der Dateialtpcie_sv_hip_avmm_hwtcl.vsuchen Sie oben in der Datei (um Zeile 148) nach den folgenden Parameterdefinitionen und übernehmen Sie die identifizierten Änderungen:

       Parameter rx_cdc_almost_full_hwtcl = 6,
       Parameter tx_cdc_almost_full_hwtcl = 6,

    Ändern Sie zu:

       Parameter rx_cdc_almost_full_hwtcl = 12,
       Parameter tx_cdc_almost_full_hwtcl = 12,

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 4 Produkte

    เอฟพีจีเอ Cyclone® V GT
    เอฟพีจีเอ Cyclone® V GX
    เอฟพีจีเอ Arria® V GX
    เอฟพีจีเอ Arria® V GT

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