Artikel-ID: 000075914 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 14.11.2013

Gibt es eine Möglichkeit, die Latenz zwischen afi_rdata_en und afi_rdata_valid in den UniPHY-basierten Speichercontrollern zu steuern?

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

In UniPHY-basierten Speichercontrollern wird zusammen mit afi_cs_n eingefügt, afi_rdata_en um eine Leseanforderung durchzuführen. Diese Leseanforderung verzögert sich intern in der PHY und wird verwendet, um die Lesedaten vom Speichergerät zu erfassen. Die PHY erklärt sich, wenn sie die gültigen afi_rdata_valid Lesedaten auf dem afi_rdata Bus steuert. Die Latenz zwischen afi_rdata_en und afi_rdata_valid ist nicht steuerbar, da sie während der Kalibrierungssequenz in der PHY eingestellt wird.

Lösung

Dies ist ein erwartetes Verhalten. Es ist nicht geplant, die Latenz zwischen afi_rdata_en und afi_rdata_valid in den UniPHY-basierten Speichercontrollern zu steuern.

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