Artikel-ID: 000075716 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 17.09.2018

Warum wird der Zeitstempelwert der Intel® Stratix® 10 Hard IP for PCI Express* IP Link Inspector überschätzt?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • Avalon-MM Intel® Stratix® 10 Hard IP für PCI Express*
  • Avalon-ST Intel® Stratix® 10 Hard IP für PCI Express*
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    Aufgrund eines Problems im Intel® Stratix® 10 Hard IP for PCI Express* Link Inspector können Sie feststellen, dass der Zeitstempelwert größer als die tatsächliche Zeit ist.

    Wenn Sie beispielsweise die Intel® Stratix® 10 Hard IP für PCI Express* Coreclkout bei 125 MHz verwenden, wird der Zeitstempelwert ungefähr 20 % über dem geschätzten Wert (12 ms im Vergleich zu den tatsächlichen 10 ms) angezeigt.

    Dies ist auf eine Diskrepanz zwischen dem benutzerdefinierten Coreclkout bei 125 MHz oder 250 MHz und dem immer von Link Inspector verwendeten 100-MHz-Takt zurückzuführen.

    Lösung

    Um dieses Problem zu umgehen, wenden Sie wie unten gezeigt einen Multiplikationsfaktor auf den Zeitstempelwert an.

    Bei Verwendung eines 125-MHz-Coreclkouts multiplizieren Sie den Zeitstempelwert mit einem Multiplikationsfaktor von 0,8 (100 MHz / 125 MHz).

    Bei Verwendung eines 250-MHz-Coreclkouts multiplizieren Sie den Zeitstempelwert mit einem Multiplikationsfaktor von 0,4 (100 MHz / 250 MHz).

     

    Dieses Problem wird voraussichtlich in einer zukünftigen Version der Intel® Quartus® Prime Pro Edition Software behoben.

     

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Stratix® 10 FPGAs und SoC FPGAs

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