Artikel-ID: 000075429 Inhaltstyp: Fehlermeldungen Letzte Überprüfung: 20.05.2013

Fehler (261003): Die eingerichtete JTAG-Kommunikation kann nicht fortgesetzt werden. Verbinden Sie Kommunikationskabel und -gerät wieder

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Quartus® II Software 12.1 SP1 und früher kann dieser Fehler beim Ausführen des SignalTap™ II Logic Analyzer angezeigt werden. Dieses Problem tritt aufgrund einer falschen Optimierung des JTAG TDO-Pfads auf. Dieses Problem betrifft Designs, die auf geräte mit Stratix® V, Arria® V und Cyclone® V ausgerichtet sind.

    Lösung

    Um dieses Problem zu vermeiden, beschränken Sie den JTAG TDO-Pfad ordnungsgemäß und kompilieren Ihr Design erneut. Um den JTAG TDO-Pfad korrekt einzuschränken, fügen Sie der Datei Synopsys Design Constraints (.sdc) die folgenden Beschränkungen hinzu.

    if { [string equal quartus_fit $::TimeQuestInfo(nameofexecutable)] }
    { set_max_delay -to [get_ports { altera_reserved_tdo } ] 0 }

    Dieses Problem wurde behoben, und der Pfad ist ab Version 13.0 der Software Quartus II korrekt eingeschränkt.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 15 Produkte

    Cyclone® V SX SoC-FPGA
    เอฟพีจีเอ Cyclone® V GT
    เอฟพีจีเอ Stratix® V GX
    เอฟพีจีเอ Stratix® V GT
    เอฟพีจีเอ Arria® V GX
    เอฟพีจีเอ Cyclone® V GX
    เอฟพีจีเอ Stratix® V GS
    เอฟพีจีเอ Arria® V GZ
    Arria® V SX SoC-FPGA
    Cyclone® V ST SoC-FPGA
    Arria® V ST SoC-FPGA
    เอฟพีจีเอ Arria® V GT
    เอฟพีจีเอ Cyclone® V E
    เอฟพีจีเอ Stratix® V E
    Cyclone® V SE SoC-FPGA

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