Artikel-ID: 000075006 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 13.05.2019

Erfüllt die Ausgabe-Haltezeit (tCLQX) des EPCQ-Geräts (Quad Serial Configuration) die Datenspeicherzeit nach der fallenden Edge-Anforderung für die aktive serielle Konfiguration (AS) in Arria® V, Stratix® V und Cyclone® V Gerät?

Umgebung

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Beschreibung

Erfüllt die Ausgabe-Haltezeit (tCLQX) des EPCQ-Geräts (Quad Serial Configuration) die Datenspeicherzeit nach der fallenden Edge-Anforderung für die aktive serielle Konfiguration (AS) in Arria® V, Stratix® V und Cyclone® V Gerät?

Lösung

FPGA

Bewertungsergebnisse

Arria® V GX/GT/SX/ST

Ja.

Das Datenblatt für EPCQ-Geräte zeigt nicht die tCLQX-Spezifikationen an. Die Arria V GX/GT/SX/ST Charakterisierungsdaten zeigen jedoch, dass das Minimum tCLQX eines EPCQ-Geräts mit derselben oder größer ist als die im Datenblatt Arria® V-Gerätes angegebene mindeste tDH-Anforderung für die AS-Konfiguration.

Arria® V GZ

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Stratix® V GT/GX/GS/E

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Cyclone®-V-Gerät

Lesen Sie den folgenden Artikel zum Thema:

Erfüllt die Ausgabe-Haltezeit (tCLQX) des EPCQ-Geräts (Quad-Serial Configuration) die Datenspeicherzeit nach der herabfallenden Edge-Anforderung an die DCLK-Konfiguration (tDH) für die aktive serielle Konfiguration (AS) in Cyclone® V-Komponente?

Zugehörige Produkte

Dieser Artikel bezieht sich auf 4 Produkte

Cyclone® V FPGAs und SoC FPGAs
Intel® FPGA-Konfigurationsbaustein EPCQ
Arria® V FPGAs und SoC FPGAs
Stratix® V FPGAs

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