Artikel-ID: 000075004 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 31.01.2019

Warum sind einige GPIO-Pins während der JIC-Programmierung in Cyclone® V SoC-Geräten niedrig?

Umgebung

  • Intel® Quartus® Prime Lite Edition
  • Intel® Quartus® Prime Standard Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems im werkseitigen Standard-SFL-Image in der Intel® Quartus® Prime Software sind einige Allzweck-I/O-Pins (GPIO) niedrig, wenn ein serielles Konfigurationsgerät mit der indirekten JTAG-Konfigurationsdatei (.jic) in den folgenden Varianten von Cyclone® V SoC-Geräten programmiert wird:

    • Cyclone V SE – Mitgliedscode A5, Paket F896 (31 mm)
    • Cyclone V SX – Mitgliedscode C5, Paket F896 (31 mm)
    • Cyclone V ST – Mitgliedscode D5, Paket F896 (31 mm)
    Lösung

    Um dieses Problem zu beheben, ersetzen Sie das ursprüngliche werksseitige SFL-Image für die betroffenen Geräte durch das korrigierte Image, indem Sie die folgenden Schritte ausführen.

    1. Herunterladen die folgende Datei und Entpacken Es.  Das korrigierte Standard-SFL-Image finden Sie sfl_enhanced_01_02d120dd.sof.
    2. Öffnen dem standardmäßigen SFL-Images-Speicherort im Verzeichnis.
      • Intel Quartus Prime Software: /quartus/common/devinfo/programmer
      • Eigenständiger Intel Quartus Prime Software Programmer: /qprogrammer/common/devinfo/programmer
    3. Suchen Sie im Verzeichnis sfl_enhanced_01_02d120dd.sof und ersetzen Sie sie durch das korrigierte SFL-Image.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 3 Produkte

    Cyclone® V SE SoC-FPGA
    Cyclone® V ST SoC-FPGA
    Cyclone® V SX SoC-FPGA

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