Artikel-ID: 000075000 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 30.06.2014

100-GbE-IP-Core hält möglicherweise nicht die durchschnittliche Mindest-Interpaket-Lücke von 12 aufrecht

Umgebung

    Intel® Quartus® II Anmeldungs-Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT

Kritisches Problem

Beschreibung

Wenn eine 100GbE IP-Kernveränderung das folgende zwei Register hat Einstellungen

  • TX CRC-Insertion eingeschaltet (Bit [0] des CRC_CONFIG Registers bei Offset ist 0x123 eingestellt)
  • Aktivieren Sie den TX-Präambeldurchgang aktiviert (Bit [0] des Preamble Pass-Through Configuration Registers am Offset 0x125 festgelegt ist)

Der IP-Kern hält möglicherweise kein durchschnittliches Mindest-Interpaket auf Lücke (IPG) von 12 bei 100 % Bandbreiten-Datenverkehr.

Dieses Problem tritt nicht in 40 GbE IP-Kernvarianten auf.

Lösung

Dieses Problem hat keine Problemumgehung. Sie müssen entweder umgestalten, um entfernen Sie die Notwendigkeit einer oder beider Funktionen, oder Sie müssen tolerieren, dass IPG während 100 % Bandbreitenverkehr nicht eingehalten wird.

Eine weitere Option ist die Verwendung des IP-Kerns mit niedriger Latenz von 40 bis 100 GbE in Ihrem Design anstelle des 40-100 GbE IP-Kerns. Geringe Latenz 100 GbE IP-Kern wird auf Einhaltung der Ethernet-Anforderung getestet eines durchschnittlichen MINDEST-IPG von 12, wenn diese beiden Funktionen aktiviert sind Auf.

Dieses Problem wird in einer zukünftigen Version der 40- und 100-Gbit/s Ethernet MAC und PHY MegaCore Funktion.

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