Artikel-ID: 000074350 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 14.12.2020

Warum steckt das nINIT_DONE Signal immer in einem HIGH-Zustand fest, wenn die Reset-Release-Intel® FPGA IP in allen Intel Agilex® Geräten verwendet wird?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • Benutzer-Reset und Takt-Gatter Intel® Stratix® Intel® Stratix® 10 FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Bedingt durch ein Problem mit der Reset Release Intel® FPGA IP in der Intel® Quartus® Prime Pro Edition Software Version 20.3 und älter steckt das nINIT_DONE Signal immer in einem HIGH-Zustand fest, wenn alle Intel Agilex Geräte verwendet werden®.

    Lösung

    Um dieses Problem zu beheben, können Sie das Design ab Version 20.4 in der Intel® Quartus® Prime Pro Edition Software neu kompilieren.

    Mit der Intel® Quartus® Prime Pro Edition Software Version 20.4 kann der von der Softwareversion 20.3 und unten generierte SOF in alle Intel Agilex® FPGAs programmiert werden. Die Intel® Quartus® Prime Pro Edition Software meldet jedoch eine kritische Warnmeldung, wenn Sie versuchen, den von Version 20.3 und unten generierten SOF über eine Befehlszeile zu programmieren. Die folgende kritische Warnmeldung wird nicht gemeldet, wenn Sie den Intel® Quartus® Prime Software Programmer verwenden.

    Kritische Warnung: Das bereitgestellte SOF wird mit Intel® Quartus® Prime Pro Edition Software Version 20.3 und unten generiert. Bitte kompilieren Sie das Design auf Intel® Quartus® Prime Pro Edition Softwareversion 20.4 und höher. Die Verwendung von in Intel® Quartus® Prime Pro Edition Software Version 20.4 und höher generierten SOF führt dazu, dass sich die Ausgabe der Reset Release Intel® FPGA IP verhalten.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Agilex™ FPGAs und SoC FPGAs

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