Artikel-ID: 000073869 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 04.06.2018

Warum zeigen die DDR4-Speicherschnittstellensignale in den Wellenformen der Beispiel-Testbench-Simulation Werte von 'hxx an?

Umgebung

    Intel® Quartus® Prime Pro Edition
    Externe Speicherschnittstellen für Intel® Arria® 10 FPGA IP
    Externe Speicherschnittstellen Intel® Stratix® 10 FPGA
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Während der RTL-Simulation können in den Wellenformen der Speicherschnittstellensignale Werte von 'hxx angezeigt werden, da die Initialisierung des Speicherinhalts nicht unterstützt wird.

    Lösung

    Um dieses Problem zu umgehen, können ausführliche Meldungen angezeigt werden, um Speicherschreib- und Lesevorgänge während der RTL-Simulation anzuzeigen, indem Folgendes aktiviert wird:

    • Überschreiben Sie vor der Quartus® Prime Software Pro Version 18.0 den Parameter "DIAG_VERBOSE_IOAUX" auf den Wert 1 in der von DDR4 IP generierten "mem_array_abphy"-Datei.
    • Aktivieren Sie in der Quartus® Prime Software Pro-Version 18.0 und höher die Option "Ausführliche Simulations-Debug-Meldungen anzeigen " auf der Registerkarte "Diagnose" der DDR4-IP. Alternativ können Sie den Parameter "MEM_ABPHY_VERBOSE" in der von DDR4 IP generierten "mem_array_abphy"-Datei auf den Wert 1 überschreiben.

    In der Standardversion der Quartus® Prime Software sind die ausführlichen Nachrichten immer aktiviert und werden angezeigt.

    Wenn die Option "Abstraktes phy für schnelle Simulation" auf der Registerkarte "Diagnose " der DDR4-IP aktiviert ist, wird das externe Speichermodell sowohl in der Pro- als auch in der Standardversion der Quartus® Prime-Software nicht verwendet. Daher zeigen die Speicherschnittstellensignale in den Wellenformen für die abstrakten PHY-Simulationen immer Werte von 'hxx an.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 2 Produkte

    Intel® Stratix® 10 FPGAs und SoC FPGAs
    Intel® Arria® 10 FPGAs und SoC FPGAs

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