Artikel-ID: 000073756 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 10.10.2013

Warum schlägt die Beispiel-Designsimulation fehl, wenn der UniPHY-Controller mit der Option nur PHY generiert wird?

Umgebung

  • Intel® Quartus® II Software
  • DDR3 SDRAM Controller mit UniPHY Intel® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Bei der Simulation des Beispieldesigns eines UniPHY-Controllers mit der Option "Nur PHY" sind einige Ports in der Controller-*_e0_c0-Instanz nicht verbunden, was zum Fehlschlagen der Simulation führt.

    Lösung

    Die Problemumgehung besteht darin, alle nicht verbundenen Eingangsports in der *_example_sim_e0_c0-Instanz der *_e0.v-Datei auf Null zu binden.

    Dieses Problem wurde in der Quartus® II-Softwareversion 13.1 behoben.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 20 Produkte

    เอฟพีจีเอ Stratix® IV E
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