Artikel-ID: 000073711 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 11.09.2012

Was ist die mindeste Zeitgebungsspezifikation für die Pulsbreite des clear Signals für Cyclone III M9K Speicherblock (TM9KCLR)?

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Die Mindest-Zeitgebungsspezifikation für die Pulsbreite des "Viiv"-Clear-Signals für Cyclone® III M9K Speicherblock (TM9KCLR) über die Geschwindigkeitsstufen lauten:

 

C6 = 371ps

C7 = 379ps

C8 = 378ps

 

Zugehörige Produkte

Dieser Artikel bezieht sich auf 1 Produkte

Cyclone® III FPGAs

Der Inhalt dieser Seite ist eine Kombination aus menschlicher und computerbasierter Übersetzung des originalen, englischsprachigen Inhalts. Dieser Inhalt wird zum besseren Verständnis und nur zur allgemeinen Information bereitgestellt und sollte nicht als vollständig oder fehlerfrei betrachtet werden. Sollte eine Diskrepanz zwischen der englischsprachigen Version dieser Seite und der Übersetzung auftreten, gilt die englische Version. Englische Version dieser Seite anzeigen.