Diskrete FPGA-Beschleuniger verbessern die TCO von Intel® Xeon® Prozessoren der 4. Generation
Beschleuniger verkürzen komplexe Aufgaben, verbessern die Gesamteffizienz und reduzieren die Gesamtbetriebskosten. Durch die Verbindung von skalierbaren Intel® Xeon® Prozessoren der 4. Generation mit Intel® Agilex™ FPGAs über bandbreitenstarke PCIe 5.0- und CXL-Schnittstellen können zusätzliche Vorteile entstehen, wie höhere Systemflexibilität, Produktdifferenzierung, mehr Leistung und bessere Sicherheit.
Beschleunigung mit Intel® Agilex™ FPGAs und skalierbaren Intel® Xeon® Prozessoren der 4. Generation
Sehen Sie sich das Video an, um zu erfahren, wie Sie die TCO mit Intel® Agilex™ FPGAs und PCIe 5.0/CXL IP als diskrete Beschleuniger, die über PCIe 5.0 oder CXL mit Intel® Xeon® Prozessoren der 4. Generation verbunden werden, verbessern können.
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Compute Express Link v1.1 IP für Intel® Agilex™ FPGAs
Die branchenweit erste FPGA-basierte CXL-Hard-IP für die Intel® Agilex™ Bauelementreihe mit R-Tile-Chiplets ist ab sofort verfügbar. Sie werden von der vollen CXL 5.0 x 16-Leistung profitieren (4x mehr als bei anderen FPGAs)1 – durch minimale Verwendung von Fabric-Ressourcen für Support-Logik aufgrund des gehärteten IP-Protokolls. Die verfügbaren IP-Varianten unterstützen sowohl die vom CXL-Konsortium definierten Anwendungsfälle Beschleuniger (Typ 1 & 2) als auch Speichererweiterung (Typ 3). Der erste IP-Rollout entspricht der CXL v1.1 Spezifikation.
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Produkt- und Leistungsinformationen
CXL-Bandbreite pro Port für Intel® Agilex™ FPGA-Hard-IP bei Gen5 x16 im Vergleich zur Soft-IP von FPGA-Konkurrenten bei Gen4 x8.