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  • Markenbezeichnung: Core i9
  • Dokumentennummer: 123456
  • Code Name: Emerald Rapids
  • Spezielle Operatoren: "Ice Lake", Ice AND Lake, Ice OR Lake, Ice*

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Serial Lite IV Intel® FPGA IP Kern

Der Serial Lite IV Intel® FPGA Intellectual Property (IP) Kern eignet sich für eine Datenkommunikation mit hoher Bandbreite für Chip-to-Chip-, Board-to-Board und Backplane-Anwendungen.

Serial Lite IV Intel® FPGA IP Benutzerhandbuch lesen ›

GTS Serial Lite IV Intel® FPGA IP Benutzerhandbuch lesen ›

GTS Serial Lite IV Intel® FPGA IP Designbeispiel Benutzerhandbuch lesen ›

Serial Lite IV Intel® FPGA IP Kern

Der Serial Lite IV IP Kern umfasst einen Media Access Control (MAC)-, Physical Coding Sublayer (PCS)- und Physical Media Attachment (PMA)-Block. Der IP unterstützt eine Datenübertragung von bis zu 58 Gbit/s pro Lane mit maximal 12 PAM4-Lanes der Intel Agilex™ 7 F-Tile General-Purpose Transceiver (FGT) und bis zu 116 Gbit/s mit maximal 4 PAM4-Lanes der Intel Agilex™ 7 F-Tile High-Speed-Transceiver (FHT) in einem einzigen Link oder 28 Gbit/s pro Lane mit maximal 16 NRZ-Lanes (Non-Return-to-Zero) von FGT und 58 Gbit/s pro Lane mit maximal 4 NRZ-Lanes von FHT. Dieses Protokoll bietet eine hohe Bandbreite, geringe Overhead-Frames und eine niedrige E/A-Anzahl und unterstützt eine hohe Skalierbarkeit sowohl bei der Anzahl der Lanes als auch bei der Geschwindigkeit. Das IP ist mit Unterstützung einer Vielzahl von Datenraten mit Ethernet-PCS-Modus des E-Tile-Transceivers und des F-Tile-Transceivers mit unseren neuesten GTS-Transceivern für die Agilex™ 5 Geräte einfach rekonfigurierbar.

Diese IP unterstützt zwei Übertragungsmodi:

  • Basismodus: Dies ist ein reiner Streaming-Modus, bei dem die Daten ohne Paketanfang, Leerzyklus und Paketende gesendet werden, um die Bandbreite zu erhöhen. Die IP nimmt die ersten gültigen Daten als Start eines Bursts an.
  • Gesamtmodus: Dies ist der Paketmodus der Datenübertragung. Ein Burst- und Sync-Zyklus wird am Anfang und am Ende eines Pakets als Abgrenzer gesendet.

Funktionsmerkmale

Merkmal Beschreibung
Datenübertragung
  • Unterstützt bis zu 116 Gbit/s pro Lane mit maximal 4 PAM4-Lanes von FHT in einem einzigen Link
  • Unterstützt bis zu 58 Gbit/s pro Lane mit maximal 4 NRZ-Lanes von FHT in einem einzigen Link.
  • Unterstützt bis zu 58 Gbit/s pro Lane mit maximal 12 PAM4-Lanes von FGT in einem einzigen Link.
  • Unterstützt bis zu 28 Gbit/s pro Lane mit maximal 16 NRZ-Lanes von FGT in einem einzigen Link.
  • Unterstützt die Modi kontinuierliches Streaming (Basic) oder Paket (Full).
  • Unterstützt Frame-Pakete mit geringem Overhead.
  • Unterstützt die Übertragung mit Byte-Granularität für jede Burst-Größe.
  • Unterstützt vom Benutzer initiierte oder automatische Lane-Ausrichtung.
  • Unterstützt programmierbare Ausrichtungsperiode.
PCs
  • Verwendet harte IP-Logik, die nahtlos an die E-Tile-Transceiver von Intel Agilex™ 7 und Intel® Stratix® 10 Bauelementen angeschlossen werden kann, um die Ressourcen für weiche Logik zu reduzieren.
  • Unterstützt den PAM4-Modulationsmodus für 100GBASE-KP4-Spezifikation. RS-FEC ist in diesem Modulationsmodus immer aktiviert.
  • Unterstützt den NRZ-Modulationsmodus mit (optionaler) KR-FEC-Fehlererkennung und -Korrektur.
  • Unterstützt 64b/66b Codierung/Decodierung.
Fehlererkennung und Handhabung
  • Unterstützt die CRC-Fehlerprüfung (Cyclic Redundancy Check) auf den Sende- (TX) und Empfangsdatenpfaden (RX).
  • Unterstützt die Überprüfung von RX-Link-Fehlern.
  • Unterstützt die RX PCS-Fehlererkennung.
Schnittstellen
  • Unterstützt nur Gesamt-Duplexpaketübertragung mit unabhängigen Verbindungen.
  • Verwendet die Punkt-zu-Punkt-Verbindung zu mehreren FPGAs mit geringer Übertragungslatenz.
  • Unterstützt benutzerdefinierte Befehle.
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IP-Status

Intellectual Property Bestellcodes Status der Bestellung
Serial Lite IV Intel® FPGA IP IP-SLITE4 In Benutzung
F-Tile Serial Lite IV Intel FPGA IP IP-SLITE4F In Benutzung

GTS Serial Lite IV Intel FPGA IP

IP-SLITE4F

Vorläufig
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Links zum Thema

Dokumentation

  • Serial Lite IV Streaming IP Designbeispiel Benutzerhandbuch für Intel® Stratix® 10 Komponenten
  • Serial Lite IV Streaming IP Kern Designbeispiel Benutzerhandbuch für Agilex™ 7 Komponenten

Komponenten-Support

  • Agilex™ 5 FPGAs und SoCs
  • Agilex™ 7 FPGAs und SoCs
  • Stratix® 10 FPGAs und SoCs

Weitere Ressourcen

IP finden

Finden Sie den richtigen Altera® FPGA IP-Core für Ihre Anforderungen.

Technischer Support

Für technischen Support zu diesem IP-Core besuchen Sie bitte Support-Ressourcen oder Intel® Premium-Support. Außerdem können Sie in dieser Funktion im Wissenscenter und in den Communities nach verwandten Themen suchen.

IP-Evaluierung und -Kauf

Bewertungsmodus und Informationen für den Kauf von Altera® FPGA IP-Cores.

IP Base Suite

Kostenlose Lizenzen für Altera® FPGA IP-Cores mit einer aktiven Lizenz für Quartus® Prime Standard oder Pro Edition Software.

Designbeispiele

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Kontaktieren Sie den Vertrieb, wenn Sie Anforderungen an die Entwicklung und Beschleunigung von Altera® FPGA-Produkten haben.

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