Intel® FPGA IP für PCIe
Das PCI Express (PCIe*)-Protokoll ist ein leistungsstarkes, skalierbares und funktionsreiches serielles Protokoll mit Datenübertragungsraten von 2,5 Gigatransfers pro Sekunde (GT/s) bis 32 GT/s und darüber hinaus. Intel® FPGA Intellectual Property (IP) für PCIe skaliert, da die PCI-SIG-Organisation Spezifikationen der nächsten Generation liefert. Intel ist seit 1992 Mitglied von PCI-SIG, und mit jeder neuen Siliziumgeneration nimmt Intel weiterhin an PCI-SIG Compliance Workshops teil, um Interoperabilität und Konformität mit aktuellen Industriestandards zu gewährleisten.
Intel® FPGA IP für PCIe
Die PCIe-IP-Lösungen umfassen Intels gehärteten PCIe-Protokollstapel, der die Transaktions- und Datenverbindungsebenen sowie eine gehärtete physikalische Ebene umfasst. Die letztere umfasst sowohl den physikalischen Mediumanschluss (PMA) als auch die physikalische untere Codierungsebene (PCS). Das PCIe IP-Portfolio von Intel umfasst auch optionale Soft-IP-Blöcke wie Direct Memory Access (DMA)-Engines und PCIe Switch. Diese einzigartige Kombination aus gehärteter und „soft“ IP bietet überlegene Leistung und Flexibilität für eine optimale Integration.
Intel bietet Intel FPGA® IP funktionsbasierte PCIe-IP-Lösungen, die sich mit der Protokoll-Roadmap der PCI-SIG weiterentwickelt haben.
- Support für bis zu PCIe 4.0 x8 mit GTS PCIe Hard IP ›
- Support für bis zu PCIe 5.0 x16 mit R-Tile PCIe Hard IP ›
- Support für bis zu PCIe 4.0 x16 und 400G Ethernet mit F-Tile PCIe Hard IP ›
- Support für bis zu PCIe 4.0 x16 mit P-Tile PCIe Hard IP ›
- Support für bis zu PCIe 3.0 x16 mit L/H-Tile PCIe Hard IP ›
- Support für bis zu 3x8 mit Hard IP auf Arria® 10 und Cyclone® 10 Geräten ›
Intel bietet auch ergänzende Soft-IPs an, die mit den oben genannten PCIe-Hard-IPs arbeiten, um PCIe-DMA- und Switch-Funktionen auszuführen.
- Agilex™ 7 FPGA – AXI Multichannel DMA IP (AXI-Stream Interface) als Ergänzung zu R-Tile PCIe Hard IP verfügbar ›
- Agilex™ 7 und Stratix® 10 FPGAs – Multichannel DMA IP (AVMM / AVST-Schnittstellen) als Ergänzung zu H-Tile (Stratix® 10)/P-Tile/F-Tile/R-Tile PCIe Hard IP verfügbar ›
- Skalierbare PCIe-Switch-IP als Ergänzung zu P-Tile/F-Tile/R-Tile PCIe Hard IP verfügbar ›
- Für weitere Informationen über Agilex™ 5 FPGA – AXI Multichannel DMA IP (AXI-Stream Interface), das als Ergänzung zur GTS PCIe Hard IP verfügbar ist, wenden Sie sich an Ihren lokalen Vertriebsmitarbeiter.
Komponenten-Support und Anzahl der PCIe-IP-Blöcke
Gerätereihe |
Anzahl der PCIe-IP-Blöcke |
PCIe Link-Geschwindigkeit 1,0 (2,5 GT/s) |
PCIe Link-Geschwindigkeit 2.0 (5,0 GT/s) |
PCIe Link-Geschwindigkeit 3.0 (8,0 GT/s) |
PCIe Link-Geschwindigkeit 4.0 (16,0 GT/s) |
PCIe Link-Geschwindigkeit 5,0 (32,0 GT/s) |
|---|---|---|---|---|---|---|
Agilex™ 7 |
1–4 pro Bauelement |
✓ |
✓ |
✓ |
✓ |
✓ |
| Agilex™ 5 | 1 bis 4 pro Bauelement | ✓ | ✓ | ✓ | ✓ | |
Stratix® 10 |
1–4 pro Bauelement |
✓ |
✓ |
✓ |
✓ |
|
10 |
1–4 pro Bauelement |
✓ |
✓ |
✓ |
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Cyclone® 10 |
1 pro Bauelement |
✓ |
✓ |
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|
Cyclone® 10 GX |
1 pro Bauelement |
✓ |
✓ |
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|
Arria® V |
1–2 pro Gerät |
✓ |
✓ |
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|
Cyclone® V GT |
2 pro Gerät |
✓ |
✓ |
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|
Cyclone® V GX |
1–2 pro Gerät |
✓ |
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|
Stratix® IV |
2–4 pro Gerät |
✓ |
✓ |
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|
Cyclone® IV GX |
1 pro Bauelement |
✓ |
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Arria® II GZ |
1 pro Bauelement |
✓ |
✓ |
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Arria® II GX |
1 pro Bauelement |
✓ |
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