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  • Markenbezeichnung: Core i9
  • Dokumentennummer: 123456
  • Codename: Alder Lake
  • Spezielle Operatoren: "Ice Lake", Ice AND Lake, Ice OR Lake, Ice*

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MACsec Intel® FPGA IP

Der MACsec Intel® FPGA IP Core implementiert den IEEE Media Access Control Security-Standard wie in 802.1AE (2018) definiert als vollständig konfigurierbaren Soft IP. MACsec sorgt beim Ethernet-Protokoll für die Vertraulichkeit und Integrität von Daten und wird häufig zum Schutz von Netzwerkverkehr in 5G-Systemen (zwischen Cloud und Rechenzentrum) sowie zwischen IoT-Geräten verwendet.

MACsec Intel® FPGA IP Benutzerhandbuch lesen ›

MACsec Intel® FPGA IP

  • Überblick

Typische Instanziierung von MACsec IP für 100 Gbit/s Full Duplex Ethernet-Datenverkehr

Funktionsmerkmale

  • IP-Funktionalität
    • Von Intel entwickelter Soft IP Core mit vollem Funktionsumfang
    • Unterstützung für Verschlüsselungs-Suites (GCM-AES-128/256, GCM-AES-XPN-128/256)
    • Unterstützt Einfügen/Entfernen von SecTAG und ICV sowie VLAN-Tag
    • Konfigurierbarer Store-and-Forward-Modus gegenüber Cut-Through-Modus für jeden Stream
    • Unterstützung für Stream-Interleaving bei Benutzer- und AES-Schnittstellen
    • Unterstützt kontrollierte und unkontrollierte Ports mit konfigurierbaren Datenbreiten
    • Unterstützt 2 Tx- und 2 Rx-Sicherheitskanäle (SC) pro Port
    • Sicherheitszuordnung soll aus 4 pro SC, insgesamt bis zu 1024 SA für 64 Ports, bestehen
    • Integration mit dem Intel 200Gbps AES und SM4 Inline Crypto Accelerator Hard IP oder dem vom Benutzer bereitgestellten Soft AES IP
    • Benutzerpakete umgehen Metadaten zur Unterstützung von PTP-Anwendungsfällen
    • Optional RX Replay Protection Check basierend auf Replay Window, Lowest Acceptable PN,
    • Next PN
    • 64 Bit MACSEC Statistikzähler gemäß MACSEC-Spezifikation bei jedem SC und SA
  • Leistungsangaben
    • IEEE 802.1AE-2018-konform
    • 200 Gbit/s Gesamtdurchsatz pro Instanz
  • Benutzer- und Systemschnittstellen
    • AXI4 Streaming-Schnittstellen für die Daten
    • AXI-Lite-Schnittstelle für den Verwaltungspfad
  • Debug- und Testfunktionen
    • Debug- und Protokollierungsfunktion
    • Testbench, Beispieldesign und Beispieldesign auf Systemebene verfügbar

IP-Status

Bestellcode

Im Rahmen von Intel® Quartus® Prime Pro Edition enthalten

Status

In Benutzung

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Links zum Thema

Unterstützte Geräte

  • Intel® Agilex™ FPGAs und SoC-FPGAs

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IP-Evaluierung und -Kauf

Bewertungsmodus und Informationen für den Kauf von Intel® FPGA IP-Cores.

Design von Intel® FPGA IP

Weitere Informationen über das Design von Intel® FPGA IP, einer großen Auswahl an serienmäßigen Kernen, die für Intel® FPGA IP optimiert sind.

IP Base Suite

Kostenlose Lizenzen für Intel FPGA IP-Cores mit einer aktiven Lizenz für Intel® Quartus® Prime Standard oder Pro Edition Software.

IOP-Prüfung

Intel vergibt die Interoperabilitätszertifizierung oder IOP-Zertifizierung an verifizierte Intel FPGA IPs oder IP-Cores von Mitgliedern des Intel FPGA Design Solutions Network.

Intel® FPGA Partner IP

Katalog nach Intel® FPGA Partnern für IP-Cores im Intel® Solutions Marketplace durchsuchen.

Designbeispiele

Designbeispiele und Referenzdesigns für Intel® FPGA-Geräte herunterladen.

IP-Zertifikationen

Intel ist bestrebt, IP-Cores bereitzustellen, die reibungslos mit Intel® FPGA-Tools oder Schnittstellenspezifikationen zusammenarbeiten.

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