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  • Markenbezeichnung: Core i9
  • Dokumentennummer: 123456
  • Code Name: Emerald Rapids
  • Spezielle Operatoren: "Ice Lake", Ice AND Lake, Ice OR Lake, Ice*

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  5. Interlaken Look-Aside Intel® FPGA IP

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Interlaken Look-Aside Intel® FPGA IP

Interlaken Look-Aside ist ein skalierbares Protokoll, das für Interoperabilität zwischen einem Datenweg-Bauelement und einem Look-Aside Coprozessor und so für kurze, transaktionsbezogene Übertragungen sorgt. Ein Look-Aside Coprozessor ist „seitlich“ des Datenwegs angeschlossen – und nicht „in-line“ im Hauptdatenweg des Switch-, Router- oder anderen Netzwerkgeräts. Interlaken Look-Aside ist nicht direkt mit Interlaken kompatibel und kann als anderer Betriebsmodus betrachtet werden.

Interlaken (2. Generation) Intel® FPGA IP Benutzerhandbuch ›

Interlaken Look-Aside Intel® FPGA IP

Interlaken Look-Aside Interconnect Protokoll

Der Interlaken Look-Aside IP Core eignet sich für die Coprocessing Paketklassifizierung, die in Netzwerkanwendungen wie Quality of Service-Routing, Erstellung von Verkehrsprofilen und Firewall-Funktionen oft zum Einsatz kommt. Die latenzarme Paketschnittstelle und die effizienten Datenverarbeitungsfunktionen des IP sorgen für ein hohes Maß an Designskalierbarkeit bei neuartigen Netzwerkanwendungen.

Dieser IP Core umfasst branchenführende Transceiver von Intel:

  • Physical Medium Attachment (PMA)
  • Physical Coding Sublayer (PCS)
  • Media Access Control (MAC) Layer.

Die PCS- und PMA-Schichten werden in den Stratix® 10, Arria® 10, Stratix V und Arria V FPGAs gehärtet.

  • Intel Sales kontaktieren ›
  • Benutzerhandbuch ›
  • IP-Bewertung und Kauf ›

Funktionsmerkmale

Intel ist seit ihrer Gründung 2007 Teil der Interlaken Alliance und arbeitet weiter an neuen innovativen Protokollfunktionen, um Kunden robuste und einfach zu implementierende Interlaken Look-Aside IP Lösungen zu ermöglichen. Der Interlaken Look-Aside Intel FPGA IP Core bietet ein breites Spektrum von Bandbreiten bis zu 300G.

Der Interlaken Look-Aside IP Core ist konform mit Interlaken Look-Aside Protocol Definition v1.1 und ermöglicht es Systementwicklern, Rechenengpässe, die mit älteren Paketklassifizierungsmethoden verbunden sind, zu eliminieren. Intel bietet auch maßgeschneiderte Interlaken Look-Aside IP Lösungen an. Um weitere Informationen zu erhalten, wenden Sie sich bitte an Ihren lokalen Vertriebsmitarbeiter.

  • Datenratenauswahl bis zu 25 Gbit/s
  • Multi-lane Konfiguration bis zu 24 Lanes
  • Unterstützung für Paketmodus
  • Datenwege mit geringer Latenz zum Übertragen und Empfangen
  • BurstShort-Support: 8 Byte oder höher
  • Bis zu zwei logische Kanäle
  • In-Band-Flusssteuerung
  • Vollständig integriertes IP (MAC, PCS und PMA-Schichten)
  • Abstimmbare Preemphasis- und Entzerrungseinstellungen
  • Benutzerdefinierte IP Bereitstellungen verfügbar zur Optimierung für verschiedene Anwendungsanforderungen
  • Verfügbar über den IP-Katalog in der Quartus® Prime Pro Edition Software

Intel und Cavium kooperieren bei der Bereitstellung einer vorverifizierten Paketklassifizierungslösung

Der Interlaken Look-Aside Intel FPGA IP Core auf einem Stratix® V FPGA mit dem NEURON Search Processor von Cavium bietet Kunden eine bewährte Paketklassifizierungslösung, die einfach in jeder Netzwerk- oder Rechenzentrumsplattform implementiert werden kann.

Um die Entscheidungsfindung unserer Kunden weiter zu erleichtern, haben Intel und Cavium einen Interoperabilitätsbericht erstellt, der über die verschiedenen Interoperabilitätsmodi und Leistungsmetriken informiert, die sich mit diesem kompletten, leistungsstarken Chipsatz erreichen lassen. Wenden Sie sich an Ihren Vertriebsmitarbeiter, um eine Kopie dieses Berichts zu erhalten.

Intel und Cavium Konnektivität Systemübersicht

Systemübersicht Details
Hardware
  • Stratix® V GX Bauelement (5SGXMA7)
  • Cavium: NEURON Search Prozessor Evaluation Board (EBA-NSP)
Interlaken Look-Aside IP Konfiguration
  • 4 Lanes x 10,3125 Gbit/s
  • 8 Lanes x 10,3125 Gbit/s
Ergebnisse
  • Zuverlässige Übergabe von Datenverkehr mit verschiedenen Paketgrößen
  • Logische Kanalverarbeitung validiert
  • Durchschnittliche Latenz = 256 nsec (auf Intel FPGA ILA IP)
  • Maximaler Paketdurchsatz = 614 Mpps bei Paketen unter 12 Byte
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IP-Status

 

Status

Anfrage für kundenspezifische Konfiguration

Bestellcodes

Aggregierte Bandbreite

20G bis <100G

IP-ILKN/50G

Aggregierte Bandbreite

100G bis <200G

IP-ILKN/10G

Aggregierte Bandbreite

200G bis <400G

IP-ILKN/200G

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Links zum Thema

Dokumentation

  • Interlaken (2. Generation) Intel® FPGA IP Benutzerhandbuch

Komponenten-Support

  • Agilex™ 5 FPGAs und SoCs
  • Agilex™ 7 FPGAs und SoCs
  • Stratix® 10 FPGAs und SoCs
  • Arria® 10 FPGAs und SoCs
  • Stratix® V FPGAs
  • Arria® V FPGAs

† Tests messen die Leistung von Komponenten bei einem bestimmten Test und mit bestimmten Systemen. Unterschiede in der Hardware, der Software oder der Konfiguration des Systems beeinflussen die tatsächliche Leistung. Wer vor dem Kauf die Leistungsfähigkeit bewerten möchte, sollte hierzu andere Informationsquellen heranziehen. Ausführlichere Angaben über die Leistung und Benchmarkergebnisse finden Sie unter www.intel.com/benchmarks. Intel und Quartus sind Marken der Intel Corporation oder ihrer Tochtergesellschaften in den USA und/oder anderen Ländern.

Weitere Ressourcen

IP finden

Finden Sie den richtigen Altera® FPGA IP-Core für Ihre Anforderungen.

Technischer Support

Für technischen Support zu diesem IP-Core besuchen Sie bitte Support-Ressourcen oder Intel® Premium-Support. Außerdem können Sie in dieser Funktion im Wissenscenter und in den Communities nach verwandten Themen suchen.

IP-Evaluierung und -Kauf

Bewertungsmodus und Informationen für den Kauf von Altera® FPGA IP-Cores.

IP Base Suite

Kostenlose Lizenzen für Altera® FPGA IP-Cores mit einer aktiven Lizenz für Quartus® Prime Standard oder Pro Edition Software.

Designbeispiele

Designbeispiele und Referenzdesigns für Altera® FPGA-Geräte herunterladen.

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Kontaktieren Sie den Vertrieb, wenn Sie Anforderungen an die Entwicklung und Beschleunigung von Altera® FPGA-Produkten haben.

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