LDPC Intel® FPGA IP
Intel beendet das geistige Eigentum (IP) für LDPC. Weitere Informationen finden Sie in der Benachrichtigung über die Einstellung von Produkten (PDN2208).
LDPC Intel® FPGA IP
5G Low-Density Parity-Check
Low-Density Parity-Check (LDPC) Codes sind lineare Fehlerkorrekturcodes mit denen Sie Nachrichten über laute Kanäle übertragen können. Intels 5G Low-Density Parity-Check (LDPC) Intel FPGA Intellectual Property (IP) Core ist ein Encoder oder Decoder mit hohem Durchsatz, der der 5G-Spezifikation des 3rd Generation Partnership Project (3GPP) entspricht. LDPC-Codes bieten eine bessere spektrale Effizienz und unterstützen den hohen Durchsatz für 5G New Radio (NR). Mit der Flexibilität von Intel FPGAs können verschiedene Konfigurationen entworfen und implementiert und neu gestaltet werden, um alle Änderungen an Basisgraf, Coderate, Z- und LR-Breite zu unterstützen.
Funktionsmerkmale
DOCSIS 3.1 |
Decoder Sofortige Umschaltung zwischen Code |
|---|---|
WiMedia 1.5 |
Encoder/Decoder Variable Codewortlänge Optionale sofortige Umschaltung zwischen Code Support für kurze und lange Rahmen |
DVB-S2 |
Encoder |
NASA |
Encoder/Decoder (CCSDS konform) Optionale niedrige Ressourcenarchitektur verfügbar MSA oder geschichte MSA Decodierung |
MATLAB* bitgenaue Modelle für die Simulation |
|
Alle Decoders haben:
- MATLAB Modelle
- Doppelpufferarchitektur zur Reduzierung der Latenz und Steigerung des Durchsatzes
- Früheres Abbruchkriterium
- Parameter für:
- Eingangsparallelismus
- Decodierungsparallelismus
- LLR Breite
- Dämpfungsfaktor
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