Cyclone® V SE SoC-FPGA
Cyclone® V SE FPGA ist für niedrige Systemkosten und Stromverbrauch mit integriertem ARM® Cortex-A9® MPCore Prozessorsystem für 614 Mbps bis 3,125 Gbps Transceiver-Anwendungen optimiert.
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Cyclone® V SE SoC-FPGA
Vorteile
Mit weniger Energie, weniger Entwicklungszeit und weniger Kosten mehr erreichen
Basiert auf der 28-nm-Low-Power-Prozesstechnologie (28LP) von TSMC, einschließlich einer Fülle von Blöcken mit harten geistigen Eigenschaften (IP), sodass Sie sich differenzieren und mehr erreichen können.
Logikintegrations- und Differenzierungsfähigkeiten
Es verfügt über ein adaptives Logikmodul (ALM) mit 8 Eingängen und digitale Signalverarbeitungsblöcke (DSP) mit variabler Genauigkeit, die bis zu 13,59 Megabit (Mb) eingebetteten Speicher ermöglichen.
Festes Prozessorsystem (HPS) mit integriertem ARM® Cortex-A9® MPCore Prozessor
Enge Integration eines Dual-Core ARM® Cortex-A9® MPCore Prozessors, Hard IP und eines FPGA in einem einzigen Cyclone® V System-on-a-Chip (SoC). Er unterstützt eine Spitzenbandbreite von über 128 Gbit/s mit integrierter Datenkohärenz zwischen dem Prozessor und der FPGA Fabric.
Anwendungsbereiche
Energieeffizienz für Antriebe der nächsten Generation
Bewältigt Komplexitäts- und Leistungsanforderungen: schnelle Regelkreise; DSP- und Rechenleistung, unterstützen mehrere Industrial Ethernet (IE)-Protokolle, Skalierbarkeit für Mehrachsensteuerung und integrierte Antriebssysteme. Verbessert die Markteinführungszeit durch Skalierbarkeit, Flexibilität und durch Hardware- und Designwiederverwendung und unterstützt funktionale Sicherheits-IP und Toolflow: Spart bis zu 24 Monate im Sicherheitszertifizierungsprozess.
IP-Closed-Circuit-Television-Überwachung
In der Lage, die Sensorschnittstelle (ohne Klebstoff für parallele Konnektivität oder serielle Hochgeschwindigkeit), die gesamte Bildsensor-Pipeline oder ISP, die einzigartige Bildverarbeitung für Wide Dynamic Range CMOS-Sensoren, die optimierte Motorsteuerung für Pan & Tilt, On-Chip-Videokomprimierung, Skalierung, Analyse, Ethernet-Controller und die Möglichkeit, Off-Chip-Encoder oder PHY-Geräte für die Übertragung anzuschließen, zu handhaben, Märkte für analoge oder IP-Kameras.
High-Definition (HD) IP-Kamera
Zukünftige Generation von HD-IP-Kameras für die Integration von DSP (Bildverarbeitung) und FPGA (HD-Videoanalyse) in einem einzigen SoC-FPGA-Chip, der HD-1080p-Videoanalyse mit großem Dynamikbereich ermöglicht. Die HD-Videoanalyse könnte auf einem der ARM-Kerne mit zusätzlicher Logik in der FPGA Fabric ausgeführt werden. In diesem Fall wird die Bildsignalverarbeitung im SoC-FPGA um Wide Dynamic Range erweitert.
Besondere Merkmale
Embedded-Speicherblöcke
- M10K: 10-Kilobit (Kb) Speicherblöcke mit Soft-Error-Correction-Code (ECC).
- Memory Logic Array Block (MLAB): Verteiltes 640-Bit-LUTRAM, bei dem bis zu 25 % der ALMs als MLAB-Speicher verwendet werden können.
E/As für allgemeine Zwecke
- 875 Megabit pro Sekunde (Mbit/s) LVDS-Empfänger (Low-Voltage Differential Signaling) und 840 Mbit/s LVDS-Sender.
- Externe Speicherschnittstelle mit 400 MHz/800 Mbit/s.
- On-Chip-Terminierung (OCT).
- 3,3 V Unterstützung mit bis zu 16 mA Ansteuerungsstärke.
Externe Speicherschnittstelle
In den Cyclone®-V-SoC-Geräten unterstützt ein zusätzlicher Hard-Memory-Controller im HPS DDR3-, DDR2- und LPDDR2-SDRAM-Geräte.
Hard Processor System (HPS)
Der HPS besteht aus einem Dual-Core Arm* Cortex* -A9 MPCore* Prozessor, einer Vielzahl von Peripheriegeräten und einem gemeinsam genutzten Multiport-SDRAM-Speichercontroller.
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