Intel® Cyclone® 10 LP FPGA
Die Cyclone® 10 LP FPGA Produktreihe von Intel erweitert die führende Position der Intel® Cyclone® FPGA Reihe auf Low-Cost- und Low-Power-Geräten. Die Intel® Cyclone® 10 LP FPGA sind ideal für hochvolumige, kostensensitive Funktionen und eignen sich für ein breites Spektrum an allgemeinen Logik-Anwendungen.
Siehe auch: FPGA Design-Software, Design Store, Downloads, Community und Support
Intel® Cyclone® 10 LP FPGA
Architektur
Der aus Gates bestehende Logik- und Routing-Kern ist auf jeder Seite von E/A-Elementen umgeben, und in jeder Ecke befindet sich eine phasenstarre Schleife (PLLs). Eingebettete Speicherblöcke (M9K) und 18 x 18-Bit-Multiplikatorenblöcke sind in vertikalen Spalten angeordnet.
Die Architektur umfasst auch hocheffiziente Interconnect- und Low-Skew-Clock-Netzwerke, die die Konnektivität zwischen Logik-Strukturen für Takt- und Datensignale gewährleisten.
Single Event Upset (SEU)
Die Erkennung von Konfigurationsfehlern wird in allen Intel® Cyclone® 10 LP Geräten unterstützt. Die Erkennung von Fehlern im Benutzermodus wird nur bei Geräten mit 1,2-V-Core-Spannung unterstützt. Dedizierte Schaltungen in Intel® Cyclone® 10 LP-Geräten umfassen eine CRC-Fehlererkennung, die optional kontinuierlich und automatisch auf einen Single-Event-Upset (SEU) prüfen kann.
In kritischen Anwendungen, die in den Bereichen Avionik, Telekommunikation, Systemsteuerung, Medizin und Militär verwendet werden, ist es wichtig, in der Lage zu sein:
- Bestätigen Sie die Richtigkeit der in einem FPGA-Baustein gespeicherten Konfigurationsdaten.
- Alarmiert das System beim Auftreten eines Konfigurationsfehlers.
Nios® II Prozessor
Der Nios® II Prozessor, der laut Gartner Research der vielseitigste, lizenzfreie Prozessor der Welt ist, ist der am häufigsten verwendete Soft-Prozessor in der FPGA-Industrie. Der Nios II Prozessor bietet eine noch nie dagewesene Flexibilität für Ihre kostensensitiven, echtzeit- und sicherheitskritischen (DO-254) sowie ASIC-optimierten Anwendungsanforderungen.
Die Produktreihe der Nios II Prozessoren umfasst zwei konfigurierbare 32-Bit Harvard-Architektur-Cores:
- Schneller (/F Kern): Sechsstufige Pipeline, die für höchste Leistung optimiert ist, optionale Speicherverwaltungseinheit (MMU) oder Speicherschutzeinheit (MPU).
- Economy (/e Kern): Optimiert für die kleinste Größe, und kostenlos erhältlich (keine Lizenz erforderlich).
Sie müssen die Leistung steigern? Kein Problem. Hardware-Beschleunigung ist so einfach wie die Verwendung der programmierbaren Logik eines FPGAs, um Aufgaben, die normalerweise in einer Anwendungssoftware implementiert sind, zu entlasten und zu beschleunigen. Erfahren Sie mehr auf der Nios® II Prozessor-Website.
Weitere Informationen über kostenlose Software-Entwicklungstools finden Sie auf der Nios® II Prozessor Design Tools Webseite.
Für Schulungen zum Nios II Prozessor besuchen Sie bitte die Intel® FPGA Technical Training Webseite.
Nios® II Prozessorleistung (DMIPS bei Fmax)
Hinweis: Dhrystones 2.1 Benchmark
Variante | Leistung (DMIPS) |
---|---|
Nios II / e Economy | 30 bei 175 MHz |
Nios II / f Schnell |
190 bei 165 MHz |
Nios® II Prozessor Anwendungen
Anwendung |
Nios® II Prozessor-Kern |
Hersteller |
Beschreibung |
---|---|---|---|
Energie- und kostenbewusst |
Nios II-Economy-Kern |
Intel® |
Mit nur 600 Logik-Elementen ist der NIOS II Economy Prozessor-Kern ideal für Mikrocontroller-Anwendungen. Der Nios II Economy Prozessor, die Software-Tools und die Gerätetreiber werden kostenlos angeboten. |
Echtzeit |
Nios® II schneller Kern |
Intel® |
Absolut deterministische, jitterfreie Echtzeitleistung mit folgenden einzigartigen Hardware-Echtzeit-Funktionsoptionen:
|
Bearbeitung von Anträgen |
Schneller Nios® II-Kern |
Intel® |
Mit einer einfachen Konfigurationsoption kann der schnelle Nios® II Prozessor-Kern eine Memory Management Unit (MMU) verwenden, um Embedded Linux* auszuführen. Es gibt sowohl Open-Source- als auch kommerziell unterstützte Versionen von Linux für NIOS II-Prozessoren. |
Sicherheitskritisch |
Nios® II SC Kern |
HCELL |
Zertifizieren Sie Ihr Design für die DO-254-Konformität, indem Sie den sicherheitskritischen Nios® II Prozessor-Kern zusammen mit den von HCELL verfügten DO-254-Konformitäts-Designservices verwenden. |
Lockstep Dual Core |
fRSmartComp IP |
Yogitech |
Die Lockstep-Lösung sorgt für einen hohen Diagnosedeckungsgrad, Selbstprüfung und erweiterte Diagnosefunktionen in voller Übereinstimmung mit den Normen für funktionale Sicherheit IEC 61508 und ISO 26262 und reduziert gleichzeitig den Bedarf an schwierig zu entwickelnden und leistungsmindernden Diagnosesoftware-Testbibliotheken. |
Die Erkennung von Konfigurationsfehlern wird in allen Intel® Cyclone® 10 LP Geräten unterstützt. Die Erkennung von Fehlern im Benutzermodus wird nur bei Geräten mit 1,2-V-Core-Spannung unterstützt. Die speziellen Schaltungen in den Cyclone 10 LP-Geräten umfassen eine CRC-Fehlererkennung, die optional kontinuierlich und automatisch auf einen Single-Event-Upset (SEU) prüfen kann.
In kritischen Anwendungen, die in den Bereichen Avionik, Telekommunikation, Systemsteuerung, Medizin und Militär verwendet werden, ist es wichtig, in der Lage zu sein:
- Bestätigen Sie die Richtigkeit der in einem FPGA-Baustein gespeicherten Konfigurationsdaten.
- Alarmiert das System beim Auftreten eines Konfigurationsfehlers.
Qualifizierung und Zertifizierung
Intel® Cyclone® 10 LP FPGAs sind in den Temperaturklassen Commercial, Industrial und Automotive (AEC-Q100) verfügbar.
Darüber hinaus werden sie in einer zukünftigen Version des Pakets für funktionale Sicherheit unterstützt, das vom TÜV nach IEC 61508 zertifiziert ist, was die Entwicklungszeit und die Zeit bis zur Markteinführung verkürzt.
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