Intel® FPGA-Komplettlösung für SerialLite II

Tabelle 1: Komplettlösung SerialLite II

Lösung

Beschreibung

Gerätereihe

Physische Schnittstelle

Integrierter PHY mit vollem PMA (1) und PCS (2) Unterstützung

SerialLite II IP-Core

Intel FPGA SerialLite II IP-Core ›

Entwicklungs-Mainboard

Charakterisierungsbericht

Stratix II GX Charakterisierungsbericht
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Referenzdesign

SerialLite II Loopback-Referenzdesign, verfügbar mit IP

Tabelle 2: Funktionen und Vorteile von SerialLite II

Merkmal

Optionen

Vorteile

Datenfluss

Vollduplex, Simplex, asymmetrisch oder Broadcast

Reduzierte Logik für Simplex-, asymmetrische oder Broadcast-Anwendungen

Datentyp

Paket oder Streaming

Support für eine Vielzahl von Anwendungen

Linkbreite

1 bis 16 Lanes

Skalierbarer Verbindungsdurchsatz von 622 Mbit/s bis 102 Gbit/s in jede Richtung

Lane-Rate

622 Mbit/s bis 6,375 Gbit/s

Datenpfadbreite

8 Bit, 16 Bit oder 32 Bit
(pro Lane)

Reduzierte Logik für Lane-Raten unter 1,5 Gbit/s und Skalierbarkeit auf 6,375-Gbit/s-Lane-Raten

Codierung

8B/10B

Industriestandard-Kodierung für die zuverlässigste Takt- und Datenwiederherstellung

Verschlüsselung

Nutzlast und Inaktivität, oder keine

Reduzierter EMI für hohe Lane-Raten

Referenztakt

Asynchron oder synchron

Passt für Chip-to-Chip-, Board-to-Board- und Backplane-Anwendungen

Polaritätsumkehr

Ja oder Nein

Implementieren Sie die für Ihre spezifische Anwendung erforderliche Funktionalität für eine kostenoptimierte Lösung

Datenintegritätsschutz

CRC-32, CRC-16 oder kein

Pakettyp

Daten, Priorität oder beide

Optionale Logik um Daten mit hoher Priorität oder Steuerinformationen einzufügen

Flusssteuerung

Datenpaket, Prioritätspaket, beide, oder keine

Implementieren Sie die für Ihre spezifische Anwendung erforderliche Funktionalität für eine kostenoptimierte Lösung

Retry-on-Error

Prioritätspaket oder keine

Erhöhte Verbindungszuverlässigkeit

Kanal-Multiplexing

Ja oder Nein

Support für Anwendungen mit mehreren logischen Kanälen

Atlantic Schnittstelle

Daten- und Prioritätsports

Gut definierte Schnittstelle zur Benutzerlogik und eine Vielzahl von Intel FPGA IP-Funktionen zur Beschleunigung der Designzyklen für einzigartige Brückenlösungen