"Pin Information for the CycloneŽ II EP2C15A, EP2C20 and EP2C20A Devices Version 2.1 Notes (1), (2)" Bank Number VREFB Group Pin Name / Function Optional Function(s) Configuration Function Q240 F256 F484 "DQS for x8/x9 in Q240" DQS for x16/x18 in Q240 DQS for x8/x9 in F256 DQS for x16/x18 in F256 DQS for x8/x9 in F484 DQS for x16/x18 in F484 B2 VREFB2N0 GND_PLL3 1 D5 F5 B2 VREFB2N0 VCCD_PLL3 2 E5 E5 B2 VREFB2N0 GND_PLL3 3 F5 F6 B2 VREFB2N0 GND B2 VREFB2N0 IO ASDO ASDO 4 C3 C4 B2 VREFB2N0 IO nCSO nCSO 5 F4 C3 B2 VREFB2N0 IO LVDS26p CRC_ERROR 6 C1 D3 DQ0L0 DQ1L0 B2 VREFB2N0 IO LVDS26n CLKUSR 7 C2 D4 DQ0L1 DQ1L1 B2 VREFB2N0 IO PLL3_OUTp 8 D3 D5 DQ0L2 DQ1L2 DQ0L0 DQ1L0 B2 VREFB2N0 IO PLL3_OUTn 9 D4 D6 DQ0L3 DQ1L3 DQ0L1 DQ1L1 B2 VREFB2N0 VCCIO2 10 B2 VREFB2N0 IO LVDS25p E3 DQ2L0 DQ1L0 B2 VREFB2N0 IO LVDS25n E4 DQ2L1 DQ1L1 B2 VREFB2N0 IO LVDS24p C1 DQ2L2 DQ1L2 B2 VREFB2N0 IO LVDS24n C2 DQ2L3 DQ1L3 B2 VREFB2N0 IO VREFB2N0 11 F3 F4 B2 VREFB2N0 IO LVDS23p G6 DQ2L4 DQ1L4 B2 VREFB2N0 IO LVDS23n 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G20 B5 VREFB5N0 IO LVDS65n E20 DQ2R1 DQ1R1 B5 VREFB5N0 IO LVDS65p F20 DQ2R0 DQ1R0 B5 VREFB5N0 IO LVDS64n 174 C15 C21 DQ0R1 DQ1R1 B5 VREFB5N0 IO LVDS64p 175 C16 C22 DQ0R0 DQ1R0 B5 VREFB5N0 VCCIO5 176 B5 VREFB5N0 IO LVDS63n C19 B5 VREFB5N0 IO LVDS63p C20 B5 VREFB5N0 IO LVDS62n C14 D19 B5 VREFB5N0 IO LVDS62p D13 D20 B5 VREFB5N0 IO PLL2_OUTp 177 E14 E19 B5 VREFB5N0 IO PLL2_OUTn 178 D14 E18 B5 VREFB5N0 GND B5 VREFB5N0 GND_PLL2 179 F12 F18 B5 VREFB5N0 VCCD_PLL2 180 F11 F17 B5 VREFB5N0 GND_PLL2 181 D12 E17 B4 VREFB4N0 VCCA_PLL2 182 E12 F16 B4 VREFB4N0 GNDA_PLL2 183 E11 E16 B4 VREFB4N0 GND B4 VREFB4N0 IO LVDS61n 184 B14 C18 B4 VREFB4N0 IO LVDS61p 185 A14 C17 DQ0T0 DQ1T0 DQ0T0 DQ1T0 B4 VREFB4N0 IO LVDS60n 186 C13 B20 DQ0T1 DQ1T1 DQ0T1 DQ1T1 DQ2T0 DQ5T0 B4 VREFB4N0 IO LVDS60p 187 C12 A20 DQ0T2 DQ1T2 DQ0T2 DQ1T2 DQ2T1 DQ5T1 B4 VREFB4N0 IO LVDS59n 188 B13 B19 DQ0T3 DQ1T3 DQ0T3 DQ1T3 DQ2T2 DQ5T2 B4 VREFB4N0 IO LVDS59p 189 A13 A19 DQ0T4 DQ1T4 DQ0T4 DQ1T4 DQ2T3 DQ5T3 B4 VREFB4N0 B4 VREFB4N0 VCCIO4 190 B4 VREFB4N0 IO LVDS58n 191 B12 B18 DQ0T5 DQ1T5 DQ0T5 DQ1T5 B4 VREFB4N0 IO LVDS58p 192 A12 A18 "CDPCLK6/ DQS0T" "CDPCLK6/ DQS0T" "CDPCLK6/ DQS0T" "CDPCLK6/ DQS0T" "CDPCLK6/ DQS0T" "CDPCLK6/ DQS0T" B4 VREFB4N0 IO LVDS57n G16 B4 VREFB4N0 GND 193 B4 VREFB4N0 IO LVDS57p H15 B4 VREFB4N0 IO VREFB4N0 194 C11 C16 B4 VREFB4N0 IO LVDS56n D16 DQ2T4 DQ5T4 B4 VREFB4N0 GND B4 VREFB4N0 IO LVDS56p E15 DQ2T5 DQ5T5 B4 VREFB4N0 VCCIO4 B4 VREFB4N0 IO LVDS55n H14 B4 VREFB4N0 IO LVDS55p J14 B4 VREFB4N0 IO LVDS54n 195 B11 D15 DQ0T6 DQ1T6 DQ0T6 DQ1T6 DQ2T6 DQ5T6 B4 VREFB4N0 VCCINT 196 B4 VREFB4N0 IO LVDS54p 197 A11 C14 DQ0T7 DQ1T7 DQ0T7 DQ1T7 DQ2T7 DQ5T7 B4 VREFB4N0 IO LVDS53n G15 B4 VREFB4N0 IO LVDS53p F15 DQ5T8 B4 VREFB4N0 GND 198 B4 VREFB4N1 IO H13 B4 VREFB4N1 GND B4 VREFB4N1 IO LVDS52n 199 B10 B17 DQ1T8 DQ1T8 B4 VREFB4N1 VCCIO4 B4 VREFB4N1 IO LVDS52p 200 A10 A17 "DPCLK8/ DQS2T" "DPCLK8/ DQS2T" "DPCLK8/ DQS2T" "DPCLK8/ DQS2T" "DPCLK8/ DQS2T" "DPCLK8/ DQS2T" B4 VREFB4N1 IO LVDS51n E14 DM2T "DM5T0/ BWS#5T0" B4 VREFB4N1 IO LVDS51p D14 DQ4T0 DQ5T9 B4 VREFB4N1 VCCINT 201 B4 VREFB4N1 IO LVDS50n F14 DQ4T1 DQ5T10 B4 VREFB4N1 IO LVDS50p F13 DQ4T2 DQ5T11 B4 VREFB4N1 IO LVDS49n B16 DQ4T3 DQ5T12 B4 VREFB4N1 GND 202 B4 VREFB4N1 IO LVDS49p A16 DQ4T4 DQ5T13 B4 VREFB4N1 GND B4 VREFB4N1 IO LVDS48n B15 DQ4T5 DQ5T14 B4 VREFB4N1 VCCIO4 B4 VREFB4N1 IO LVDS48p A15 DQ4T6 DQ5T15 B4 VREFB4N1 IO H12 B4 VREFB4N1 IO VREFB4N1 203 D9 C13 B4 VREFB4N1 VCCINT 204 B4 VREFB4N1 IO LVDS47n F12 DQ4T7 DQ5T16 B4 VREFB4N1 IO LVDS47p G12 B4 VREFB4N1 IO LVDS46n B14 DQ5T17 B4 VREFB4N1 GND 205 B4 VREFB4N1 IO LVDS46p A14 DM4T "DM5T1/ BWS#5T1" B4 VREFB4N1 GND 206 B4 VREFB4N1 IO LVDS45n D11 B13 DM0T "DM1T0/ BWS#1T0" B4 VREFB4N1 VCCIO4 207 B4 VREFB4N1 IO LVDS45p 208 D10 A13 "DPCLK9/ DQS4T" "DPCLK9/ DQS4T" "DPCLK9/ DQS4T" "DPCLK9/ DQS4T" "DPCLK9/ DQS4T" "DPCLK9/ DQS4T" B4 VREFB4N1 CLK8 LVDSCLK4n/input(3) 209 A9 B12 B4 VREFB4N1 CLK9 LVDSCLK4p/input(3) 210 B9 A12 B3 VREFB3N0 VCCINT 211 B3 VREFB3N0 CLK10 LVDSCLK5n/input(3) 212 A8 D12 B3 VREFB3N0 CLK11 LVDSCLK5p/input(3) 213 B8 E12 B3 VREFB3N0 IO LVDS44n 214 A7 B11 DM0T "DM1T0/ BWS#1T0" DQ1T0 DQ1T9 B3 VREFB3N0 GND 215 B3 VREFB3N0 IO LVDS44p 216 B7 A11 "DPCLK10/ DQS5T" "DPCLK10/ DQS5T" "DPCLK10/ DQS5T" "DPCLK10/ DQS5T" "DPCLK10/ DQS5T" "DPCLK10/ DQS5T" B3 VREFB3N0 GND B3 VREFB3N0 IO LVDS43n E11 DQ5T0 DQ3T0 B3 VREFB3N0 VCCIO3 B3 VREFB3N0 IO LVDS43p D11 DQ5T1 DQ3T1 B3 VREFB3N0 IO LVDS42n H11 B3 VREFB3N0 IO LVDS42p G11 B3 VREFB3N0 IO LVDS41n B10 DQ5T2 DQ3T2 B3 VREFB3N0 IO LVDS41p A10 DQ5T3 DQ3T3 B3 VREFB3N0 IO LVDS40n F11 DQ5T4 DQ3T4 B3 VREFB3N0 IO LVDS40p F10 DQ5T5 DQ3T5 B3 VREFB3N0 GND 217 B3 VREFB3N0 IO VREFB3N0 218 D8 C10 B3 VREFB3N0 VCCIO3 219 B3 VREFB3N0 IO LVDS39n B9 DQ5T6 DQ3T6 B3 VREFB3N0 VCCINT 220 B3 VREFB3N0 IO LVDS39p A9 DQ5T7 DQ3T7 B3 VREFB3N0 IO LVDS38n H10 B3 VREFB3N0 IO LVDS38p H9 B3 VREFB3N0 GND 221 B3 VREFB3N0 IO LVDS37n E9 DQ5T8 DQ3T8 B3 VREFB3N0 IO LVDS37p D9 "DM5T/ BWS#5T" "DM3T0/ BWS#3T0" B3 VREFB3N0 IO LVDS36n 222 B6 B8 DQ1T0 DQ1T9 DQ1T1 DQ1T10 B3 VREFB3N0 GND B3 VREFB3N0 IO LVDS36p 223 A6 A8 "DPCLK11/ DQS3T" "DPCLK11/ DQS3T" "DPCLK11/ DQS3T" "DPCLK11/ DQS3T" "DPCLK11/ DQS3T" "DPCLK11/ DQS3T" B3 VREFB3N1 VCCIO3 B3 VREFB3N1 IO LVDS35n B7 DQ3T0 DQ3T9 B3 VREFB3N1 VCCINT 224 B3 VREFB3N1 IO LVDS35p A7 DQ3T1 DQ3T10 B3 VREFB3N1 IO LVDS34n F9 DQ3T2 DQ3T11 B3 VREFB3N1 IO LVDS34p E8 DQ3T3 DQ3T12 B3 VREFB3N1 GND 225 B3 VREFB3N1 IO LVDS33n D8 DQ3T4 DQ3T13 B3 VREFB3N1 IO LVDS33p C9 DQ3T5 DQ3T14 B3 VREFB3N1 IO 226 D7 D7 DQ1T1 DQ1T10 DQ1T2 DQ1T11 DQ3T6 DQ3T15 B3 VREFB3N1 GND 227 B3 VREFB3N1 IO LVDS32n 228 D6 F8 DQ1T2 DQ1T11 DQ1T3 DQ1T12 DQ3T7 DQ3T16 B3 VREFB3N1 VCCIO3 229 B3 VREFB3N1 IO LVDS32p 230 C6 G8 DQ1T3 DQ1T12 DQ1T4 DQ1T13 B3 VREFB3N1 IO H8 B3 VREFB3N1 IO VREFB3N1 231 C5 C7 B3 VREFB3N1 IO 232 C4 E7 DQ1T4 DQ1T13 DQ1T5 DQ1T14 DQ3T8 DQ3T17 B3 VREFB3N1 IO LVDS31n G7 B3 VREFB3N1 IO LVDS31p H7 B3 VREFB3N1 IO LVDS30n 233 B5 B6 DQ1T5 DQ1T14 DQ1T6 DQ1T15 B3 VREFB3N1 GND B3 VREFB3N1 IO LVDS30p 234 A5 A6 "CDPCLK7/ DQS1T" "CDPCLK7/ DQS1T" "CDPCLK7/ DQS1T" "CDPCLK7/ DQS1T" "CDPCLK7/ DQS1T" "CDPCLK7/ DQS1T" B3 VREFB3N1 VCCIO3 B3 VREFB3N1 IO LVDS29n B5 "DM3T/ BWS#3T" "DM3T1/ BWS#3T1" B3 VREFB3N1 IO LVDS29p A5 B3 VREFB3N1 IO LVDS28n 235 B4 B4 DQ1T6 DQ1T15 DQ1T7 DQ1T16 B3 VREFB3N1 IO LVDS28p 236 A4 A4 DQ1T7 DQ1T16 DQ1T8 DQ1T17 B3 VREFB3N1 IO LVDS27p 237 A3 A3 DQ1T8 DQ1T17 "DM1T/ BWS#1T" "DM1T1/ BWS#1T1" B3 VREFB3N1 IO LVDS27n DEV_CLRn 238 B3 B3 "DM1T/ BWS#1T" "DM1T1/ BWS#1T1" B3 VREFB3N1 GND B3 VREFB3N1 GNDA_PLL3 239 E6 F7 B3 VREFB3N1 VCCA_PLL3 240 F6 E6 VCCINT F9 J10 VCCINT F10 J11 VCCINT G7 J12 VCCINT G9 J13 VCCINT G11 K9 VCCINT H7 K14 VCCINT H10 L9 VCCINT H11 L14 VCCINT J6 M9 VCCINT J7 M14 VCCINT J10 N9 VCCINT K6 N14 VCCINT K8 P10 VCCINT K10 P11 VCCINT L7 P12 VCCINT L8 P13 VCCIO2 B1 B1 VCCIO2 J7 VCCIO2 G3 L3 VCCIO1 K3 AA1 VCCIO1 M3 VCCIO1 P7 VCCIO1 R1 T4 VCCIO8 M7 AB2 VCCIO8 T9 VCCIO8 P7 V10 VCCIO8 W6 VCCIO8 T2 Y11 VCCIO7 M10 AB21 VCCIO7 T14 VCCIO7 P10 V13 VCCIO7 W17 VCCIO7 T15 Y12 VCCIO6 K14 AA22 VCCIO6 M20 VCCIO6 R16 P16 VCCIO6 T19 VCCIO5 B16 B22 VCCIO5 G19 VCCIO5 J16 VCCIO5 G14 L20 VCCIO4 A15 A21 VCCIO4 C10 C12 VCCIO4 D17 VCCIO4 E13 VCCIO4 E10 G14 VCCIO3 A2 A2 VCCIO3 C6 VCCIO3 C7 C11 VCCIO3 E10 VCCIO3 E7 G9 GND F7 K10 GND F8 K11 GND G6 K12 GND G8 K13 GND G10 L10 GND H6 L11 GND H8 L12 GND H9 L13 GND J8 M10 GND J9 M11 GND J11 M12 GND K7 M13 GND K9 N10 GND K11 N11 GND L9 N12 GND L10 N13 GND A1 A1 GND A22 GND A16 AA2 GND B2 AA21 GND AB1 GND AB22 GND B15 B2 GND C8 B21 GND C5 GND C8 GND C9 C15 GND D10 GND E8 D13 GND E9 D18 GND F19 GND H3 G4 GND G10 GND G13 GND H14 H20 GND J3 K3 GND K7 GND K16 GND J14 K19 GND M8 M4 GND N7 GND N16 GND M9 N19 GND P8 R3 GND T10 GND P9 T13 GND T20 GND V3 GND R2 V6 GND R15 V17 GND W10 GND T1 W13 GND W19 GND Y8 GND T16 Y15 NC G1 NC G2 NC H21 NC H22 NC J3 NC J5 NC J6 NC J8 NC J9 NC K8 NC K15 NC K17 NC K18 NC L7 NC L15 NC L16 NC L17 NC M7 NC M8 NC M15 NC M16 NC N5 NC N8 NC P4 NC P14 NC P19 NC P20 NC P21 NC P22 NC R4 NC W18 Notes: "(1) The optional functions (e.g. LVDS, DDR) are not available for some pins in certain packages." " For example, for the EP2C8 device, the LVDS70 pair is available for the Q208 and F256 packages, but not for the T144 package. " "(2) The DQS0T, DQS1T, DQS0B, and DQS1B pin functions are only available in the F672 and F896 packages." "(3) If the dedicated CLK pins are not used to feed the global clock networks, they can be used as general-purpose input pins to feed the core logic." The dedicated CLK pins do not support the I/O register.